Xeon Phi est une série abandonnée de x86 conçus et fabriqués par Intel. Elle était destinée à être utilisée dans les supercalculateurs, les serveurs et les stations de travail haut de gamme. Son architecture permettait l’utilisation de langages de programmation standard et d’interfaces de programmation (API) telles que OpenMP.
Xeon Phi a été lancée en 2010. Comme elle était à l’origine basé sur une conception de GPU antérieure (nom de code « Larrabee ») d’Intel qui a été annulée en 2009, il partageait des domaines d’application avec les GPU. La principale différence entre Xeon Phi et un GPGPU comme Nvidia Tesla était que Xeon Phi, avec un cœur compatible x86, pouvait, avec moins de modifications, exécuter un logiciel qui était à l’origine destiné à un processeur x86 standard.
Initialement sous la forme de cartes d’extension basées sur PCI Express, un produit de deuxième génération, nom de code "Knights Landing", a été annoncé en . Ces puces de deuxième génération pourraient être utilisées comme un processeur autonome, plutôt que comme une simple carte d’extension.
En , le supercalculateur Tianhe-2 du Centre national des supercalculateurs de Guangzhou (NSCC-GZ) a été annoncé comme le supercalculateur le plus rapide du monde (en , il s’agit du n° 10). Il a utilisé des coprocesseurs Intel Xeon Phi et des processeurs Xeon E5 v2 Ivy Bridge-EP pour atteindre 33,86 pétaFLOPS.
La gamme de produits Xeon Phi était en concurrence directe avec les gammes Tesla de Nvidia et Radeon Instinct d'AMD pour l’apprentissage profond et les cartes GPGPU. Elle a été abandonnée en raison d’un manque de demande et des problèmes d’Intel avec son nœud 10 nm.
Historique Nom de code Procédé Commentaires Knights Ferry 45 nm Sous forme d'une carte PCI Express ; dérivé du projet Larrabee Knights Corner 22 nm dérivé du cœur P54C ; vector processing unit (VPU) ; premier composant appelé Xeon Phi ; codage de type AVX-512 Knights Landing 14 nm dérivé du cœur Silvermont/Airmont (Intel Atom) ; AVX-512 Knights Mill 14 nm presque identique à Knights Landing mais optimisé pour l'apprentissage profond Knights Hill 10 nm annulé thumb|Une gamme de coprocesseurs Xeon Phi. A partir de la gauche : Knights Ferry, Knights Corner, Knights Landing.
Contexte La microarchitecture Larrabee (en développement depuis 2006) a introduit des unités SIMD très larges (512 bits) dans une conception de processeur basée sur l’architecture x86, étendue à un système multiprocesseur à cache cohérent connecté via un bus en anneau à la mémoire ; chaque cœur était capable d’un multithreading quadruple. En raison de la conception destinée au GPU ainsi qu’à l’informatique à usage général, les puces Larrabee comprenaient également du matériel spécialisé pour l’échantillonnage de textures. Le projet de production d’un produit GPU commercial directement à partir du projet de recherche Larrabee a été stoppé en .
Un autre projet de recherche contemporain d’Intel mettant en œuvre l’architecture x86 sur un processeur multicœur à plusieurs cœurs était le « » (prototype introduit en 2009), une conception imitant un centre de données informatique en nuage sur une seule puce avec plusieurs cœurs indépendants : la conception du prototype comprenait 48 cœurs par puce avec prise en charge matérielle pour le contrôle sélectif de la fréquence et de la tension des cœurs afin de maximiser l’efficacité énergétique, et incorporait un réseau maillé pour la messagerie inter-puces. La conception manquait de cœurs à cache cohérent et se concentrait sur des principes qui permettraient à la conception de s’adapter à beaucoup plus de cœurs.
La (prototype dévoilé en 2007) est une puce expérimentale à 80 cœurs avec deux unités de calcul en virgule flottante par cœur, mettant en œuvre une architecture VLIW 96 bits au lieu de l’architecture x86. Le projet a étudié les méthodes de communication intercœur, la gestion de l’alimentation par puce, et a atteint 1,01 TFLOPS à 3,16 GHz consommant 62 W.
Références
Catégorie:Microprocesseur x86 Intel Catégorie:Produit lancé en 2010